công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
CS2000-CP bảng dữ liệu(PDF) 11 Page - Cirrus Logic |
|
CS2000-CP bảng dữ liệu(HTML) 11 Page - Cirrus Logic |
11 / 36 page CS2000-CP DS761F1 11 CONTROL PORT SWITCHING CHARACTERISTICS - SPI FORMAT Inputs: Logic 0 = GND; Logic 1 = VD; CL =20pF. Notes: 13. tspi is only needed before first falling edge of CS after power is applied. tspi = 0 at all other times. 14. Data must be held for sufficient time to bridge the transition time of CCLK. 15. For fcclk < 1 MHz. Parameter Symbol Min Max Unit CCLK Clock Frequency fccllk -6 MHz CCLK Edge to CS Falling (Note 13)tspi 500 - ns CS High Time Between Transmissions tcsh 1.0 - µs CS Falling to CCLK Edge tcss 20 - ns CCLK Low Time tscl 66 - ns CCLK High Time tsch 66 - ns CDIN to CCLK Rising Setup Time tdsu 40 - ns CCLK Rising to DATA Hold Time (Note 14)tdh 15 - ns Rise Time of CCLK and CDIN (Note 15)tr2 - 100 ns Fall Time of CCLK and CDIN (Note 15)tf2 - 100 ns Delay from Supply Voltage Stable to Control Port Ready tdpor 100 - µs t r2 t f2 t dsu t dh t sch t scl CS CCLK CDIN t css t csh t spi tdpor VD Figure 6. Control Port Timing - SPI Format (Write Only) |
Số phần tương tự - CS2000-CP_09 |
|
Mô tả tương tự - CS2000-CP_09 |
|
|
Link URL |
Chính sách bảo mật |
ALLDATASHEET.VN |
Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
Family Site : ic2ic.com |
icmetro.com |