công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
STP16DP05XTTR bảng dữ liệu(PDF) 10 Page - STMicroelectronics |
|
STP16DP05XTTR bảng dữ liệu(HTML) 10 Page - STMicroelectronics |
10 / 29 page Timing diagrams STP16DP05 10/29 5 Timing diagrams Note: OUTn = ON when Dn = H OUTn = OFF when Dn = L Figure 7. Timing diagram Note: The latches circuit holds data when the LE\DM1 terminal is Low. 1 When LE\DM1 terminal is at High level, latch circuit hold the data it passes from the input to the output. 2 When OE\DM2 terminal is at Low level, output terminals OUT0 to OUT15 respond to the data, either ON or OFF. 3 When OE\DM2 terminal is at High level, it switches off all the data on the output terminal. Table 9. Truth table CLOCK LE\DM1 OE\DM2 SERIAL-IN OUT0 ............. OUT7 ................ OUT15 SDO H L Dn Dn ..... Dn - 7 ..... Dn -15 Dn - 15 L L Dn + 1 No change Dn - 14 H L Dn + 2 Dn + 2 ..... Dn - 5 ..... Dn -13 Dn - 13 X L Dn + 3 Dn + 2 ..... Dn - 5 ..... Dn -13 Dn - 13 X H Dn + 3 OFF Dn - 13 OE\DM2 LE\DM1 |
Số phần tương tự - STP16DP05XTTR |
|
Mô tả tương tự - STP16DP05XTTR |
|
|
Link URL |
Chính sách bảo mật |
ALLDATASHEET.VN |
Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
Family Site : ic2ic.com |
icmetro.com |