công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
ADM1064ACP bảng dữ liệu(PDF) 6 Page - Analog Devices |
|
ADM1064ACP bảng dữ liệu(HTML) 6 Page - Analog Devices |
6 / 32 page ADM1064 Rev. 0 | Page 6 of 32 Parameter Min Typ Max Unit Test Conditions/Comments SERIAL BUS TIMING Clock Frequency, fSCLK 400 kHz Bus Free Time, tBUF 4.7 µs Start Setup Time, tSU;STA 4.7 µs Start Hold Time, tHD;STA 4 µs SCL Low Time, tLOW 4.7 µs SCL High Time, tHIGH 4 µs SCL, SDA Rise Time, tr 1000 µs SCL, SDA Fall Time, tf 300 µs Data Setup Time, tSU;DAT 250 ns Data Hold Time, tHD;DAT 5 ns Input Low Current, IIL 1 µA VIN = 0 SEQUENCING ENGINE TIMING State Change Time 10 µs 1 At least one of the VH, VP1-4 pins must be ≥ 3.0 V to maintain the device supply on VDDCAP. 2 Specification is not production tested, but is supported by characterization data at initial product release. |
Số phần tương tự - ADM1064ACP |
|
Mô tả tương tự - ADM1064ACP |
|
|
Link URL |
Chính sách bảo mật |
ALLDATASHEET.VN |
Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
Family Site : ic2ic.com |
icmetro.com |