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LC78626KE bảng dữ liệu(PDF) 11 Page - Sanyo Semicon Device |
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11 / 33 page LC78626KE No.5995-11/33 端子アプリケーション 1) HF信号入力回路 18ピン:EFMI, 17ピン:EFMO, 1ピン:DEFI, 20ピン:CLV + EFMIにHF信号を入力すると、最適レベルでスライスされた EFM信号 (NRZ)が得られる。 DEFECT対策として、DEFI端子 (1ピン)が「H」になるとスラ イスレベル・コントロール出力EFMO端子 (17ピン)がハイ・イ ンピーダンスになり、スライスレベルのホールドを行う。ただ し、CLVが位相制御モード すなわち V/P端子 (22ピン)が「L」 の時のみ有効である。これは、LA9230/40/50シリーズのDEF 端子との組合せにより構成することができる。 ※ EFMIとCLV +の信号ライン間が近い時は、不要輻射によ るエラーレートの悪化を招くことがあるので、この信号ラ イン間にGND または VDDのシールドラインを配置するこ とを推奨する。 2) PLL クロック再生回路 3ピン:PDO, 5ピン:ISET, 7ピン:FR VCO回路を内蔵しており、R, Cの外付けでPLL回路を構成する。 ISETはチャージポンプの基準電流, PDOはVCO回路のループフ ィルタ, FRはVCOの周波数範囲を決定する抵抗である。 (参考値) R1=68kΩ, C1=0.1μF (標準速時) C1=0.047μF (2倍速時) R2=680Ω, C2=0.1μF R3=1.2kΩ ※ R3の抵抗は許容差±5.0%の炭素皮膜抵抗を使用するこ とを推奨する。 3) VCOモニタ 29ピン:PCK VCOを1/2分周した平均4.3218MHz のモニタ端子。 4) 同期検出モニタ 30ピン:FSEQ EFM信号をPCKで読取ったフレームシンク (真の同期信号)とカウンタで生成したタイミング (内挿の同期信号)とが一致し た時に「H」となる。同期検出モニタとなる (1フレーム間「H」を保持)。 HF信号 SLC + − SLI VREF 17 18 EFMO EFMI A11280 A11281 5 3 7 29 ISET PDO FR PCK VCO チャージポンプ 1/2 周波数 位相 比較 EFM(NRZ) VDD R1 C1 R3 R2 C2 |
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